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新闻动态

标题 发表时间
  • InterMotion技术公司使用Active-HDL提高了莱迪思半导体CrossLink FPGA系列的IP验证效率
  • 2022/9/15
  • 嵌入式世界的Aldec和Codasip:展示一个集成的UVM模拟环境,用于验证RISC-V核的自定义指令
  • 2022/9/15
  • Cobham Gaisler使用Aldec的Riviera PRO进行HDL模拟,成功验证了其第一个RISC-V处理器NOEL-V
  • 2022/9/15
  • 北京阿尔戴信息技术有限公司已经正式取得意大利QUIPU公司在大中华地区的独家总代授权
  • 2019/10/29
  • VHDL 2018支持和提高了自动化水平——AldeC在Riviera-PRO中加入了VHDL标准1076-2018扩展和自动覆盖率模型生成
  • 2019/1/16
  • Aldec在欧洲DVCon上发表了《通过带有QEMU的混合HDL仿真和模拟环境进行硬件和软件协同验证》指南,以演示如何让工程师获得SoC设计的整体视图
  • 2019/1/16
  • 俯视视觉
  • 2019/1/16
  • 可见的成果
  • 2019/1/16
  • 半导体维基(SemiWiki): 提高有限状态机(FSM)的早期静态检查
  • 2019/1/16
  • Aldec在第6届中国国际FPGA工业发展论坛进行宣讲
  • 2019/1/16
  • 提升了有限状态机(FSM)和基于Xilinx的IP设计的早期静态检查
  • 2019/1/16
  • 半导体维基(SemiWiki): 注册抽象层(RAL), 代码检查和VHDL-2018
  • 2019/1/16
  • Aldec在DAC 2018上演示了创造性的SoC设计和验证方法学
  • 2019/1/16
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